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EsameEsame completoTesto d’esame

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Esame completo di Fondamenti di Elettronica per il corso di Computer Engineering presso Politecnico di Milano. Materiale proveniente dall’archivio storico Studwiz e classificato per la consultazione online.

Fondamenti di ElettronicaEsame completo

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Esame completo di Fondamenti di Elettronica per il corso di Computer Engineering presso Politecnico di Milano. Materiale proveniente dall’archivio storico Studwiz e classificato per la consultazione online.

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Fondamenti di Elettronica – Ing. AUTOMATICA e INFORMATICA - AA 2008/2009 Appello straordinario - 5 febbraio 2010 Indicare chiaramente la domanda a cui si sta rispondendo. Ad esempio 1a) … Giustificare chiaramente e sinteticamente le risposte! Esercizio 1 Con riferimento al circuito in figura a), dove R1=10k Ω R2=100k Ω Rin=1k Ω C=1nF: a) Disegnare in un diagramma quotato in funzione del tempo l’andamento di Vout quando Vin ha l’andamento riportato in Fig. b. b) Se l’amplificatore operazionale fosse caratterizzato da SR=100kV/s, cambierebbe la risposta alla domanda a)? Giustificare la risposta. c) Le correnti di Bias dell’amplificatore operazionale valgono 1µA (entranti). Quanto vale Vout? (Vin=0V) d) Sia Vin=100mVsin(2 πft), con f=1.6MHz. Disegnare su un diagramma quotato in funzione del tempo l’andamento di Vout a regime (1 periodo). e) L’amplificatore operazionale è caratterizzato da un guadagno Ad(s)=10 5/[(1+ τ1s) (1+ τ2s)], τ1=1ms, τ2=110ns. Disegnare il diagramma di Bode quotato del modulo del guadagno d’anello e calcolare il margine di fase . R1 R2 C Rin Vin Vout 0 10 µs t Vin 100mV Esercizio 2 Si consideri il circuito mostrato nella figura a lato. Il MOSFET ha V T=-1V e k=0.5mA/V 2. a) Polarizzare il circuito. b) Calcolare i guadagni ad alta frequenza di piccolo segnale v os /v g e v os /v g. c) Disegnare su un diagramma temporale quotato la forma d’onda V od (t) (segnale e polarizzazione) in risposta al segnale di ingresso v in (t). d) Il gradino di ingresso v in (t) di -0.1V può essere considerato un piccolo segnale? Giustificare la risposta. Esercizio 3 Le porte logiche del circuito CMOS di Fig. 1 sono alimentate con una tensione di V DD =5V e hanno una soglia di commutazione a V DD /2. Si assumano i ritardi di commutazione trascurabili e le resistenze di…

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