Informazioni sul documento
- Università
- Politecnico di Milano
- Corso di laurea
- Computer Engineering
- Materia
- Reti Logiche
- Anno accademico
- 2012-2013
- Classificazione
- Esame · Esame completo
- Contenuto
- Testo d’esame
- Formato originale
- Testo
- Testo ricercabile
Esame completo di Reti Logiche per il corso di Computer Engineering presso Politecnico di Milano. Materiale proveniente dall’archivio storico Studwiz e classificato per la consultazione online.
Esame completo di Reti Logiche per il corso di Computer Engineering presso Politecnico di Milano. Materiale proveniente dall’archivio storico Studwiz e classificato per la consultazione online.
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Politecnico di Milano Dipartimento di Elettronica e Informazione prof.ssa Anna Antola prof.ssa Cristiana Bolchini Reti Logiche – Appello del 18 febbraio 2013 Matricola _________ F i r m a Cognome_____________________ Nome ________________________ Istruzioni • Non separare questi fogli. • È vietato portare all’esame libri, eserciziari, appunti e calcolatrici. Chiunque venga trovato in possesso di documentazione re lativa al corso – anche se non strettamente attinente alle domande proposte – vedrà annullata la propria prova. • Non è possibile lasciare l’aula conservando il tema della prova in corso. • Tempo a disposizione: 2h:00m. Esercizio 1 (8 punti) _________________________ Esercizio 2 (8 punti) _________________________ Esercizio 3 (8 punti) _________________________ Esercizio 4 (8 punti) _________________________ Esercizio n. 1 Siano dati i due numeri razionali A10MS= − 10.3125 e B10MS = + 0.3. Rappresentare A e B in base 2 notazione virgola mobile singola precisione IEEE 754, quindi effettuare la somma algebrica e rappresentare il risultato completo. Nell’operazione di conversione di A e di B usare un massimo di 7 cifre significative per la mantissa normalizzata. Mostrare tutti passaggi sia per lo svolgimento della conversione sia per l’operazione di somma. Reti Logiche – Appello del 18 febbraio 2012 pagina 2 di 2 Esercizio n. 2 Si vuole realizzare una macchina sequenziale sincrona tramite componenti programmabili. La macchina sequenziale ha tre ingressi a, b, c e una uscita Y ed è così definita: (a) la funzione di uscita λ è descritta tramite la rete multilivello sotto riportata V1 = ab + !Q1 + ac + bQ3 V2 = Q2!V1 + Q1V1 V3 = a + c Y = V2 + c !Q2 + Q3 V3 Dove Q1, Q2 e Q3 rappresentano le variabili stato presente del contatore che specifica la funzione δ (vedi…
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